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文檔簡介

tus半加器，仿真驗證其功能，并生成新的半加器圖2)用剛生成的半加器模塊和邏輯門設(shè)計與實現(xiàn)一個全加器，仿真驗證，發(fā)光二級(1)半加器2)其邏輯函數(shù)是S(A,B=A⊕B,C=AB.真值表如下AOO11BO101S0110C00011)全加器可以由兩個半加器和一個或門構(gòu)成。全加器有三個輸入值，兩個輸AOOOO1BO0110CO1010SO1101CO00101110111010011111)利用QuartusII選擇譯碼器(74L138)的圖形模塊單元。2)邏輯函數(shù)為F=+B+C+CBA，真值表如下ABCF000011110011001101010101111000013)因為，所以函數(shù)F可以通過譯碼器(74L138)和一個與非門實現(xiàn)。將譯3.3線—8線譯碼器(74L138)設(shè)計實現(xiàn)函數(shù)的仿真波形圖分析：地方： (1)開始仿真波形時，需注意設(shè)定ENDTIME，否則無法進(jìn)行仿真。 (2)規(guī)定輸入端波形的周期，須按照倍數(shù)關(guān)系來設(shè)定，不能隨意設(shè)定周期， (3)當(dāng)完成半加器，要開始進(jìn)行全加器設(shè)計時，注意生成半加器圖形模塊單 (4)注意保存文件時，命名的一致性，否則可能導(dǎo)致實驗無法進(jìn)行下去。 (5)將設(shè)計好的邏輯電路下載到實驗板之前，應(yīng)設(shè)定好引腳。注意實驗板上電路與邏輯設(shè)計學(xué)習(xí)的道路上，我懂得了如何將理論課上所學(xué)的驗中并能得到驗證，對數(shù)字電路與邏輯設(shè)計的知識有了更

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