微電子概論（第3版）課件6-2-1數(shù)字系統(tǒng)EDA技術(shù)-傳統(tǒng)ASIC設(shè)計(jì)流程_第1頁(yè)
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IntroductiontoMicroelectronicsThirdEdition《微電子概論》（第3版）郝躍賈新章史江一6.2.1傳統(tǒng)ASIC設(shè)計(jì)流程6.2數(shù)字系統(tǒng)EDA技術(shù)目錄6.2.2并行交互式數(shù)字集成電路設(shè)計(jì)流程6.2.3IP核自頂向下設(shè)計(jì)方法特征：把整個(gè)系統(tǒng)看成單一系統(tǒng)，從頂層對(duì)其進(jìn)行體系結(jié)構(gòu)設(shè)計(jì)和功能劃分，把整個(gè)系統(tǒng)逐級(jí)分成若干個(gè)子系統(tǒng)、子子系統(tǒng)，按代碼-電路-版圖的順序?qū)崿F(xiàn)的設(shè)計(jì)方法優(yōu)點(diǎn)：與EDA工具契合度好，便于施加約束，需要人工干預(yù)少缺點(diǎn)：對(duì)運(yùn)行服務(wù)器平臺(tái)要求較高，對(duì)于巨大規(guī)模電路，機(jī)器機(jī)時(shí)消耗較大，甚至?xí)驗(yàn)橐?guī)模太大而無(wú)法完成

應(yīng)用場(chǎng)景：規(guī)模適中電路，或者大系統(tǒng)的子模塊自底向上設(shè)計(jì)方法特征：先進(jìn)行底層子模塊設(shè)計(jì)，完成子模塊后，再把子模塊集成，完成整體系統(tǒng)設(shè)計(jì)的方法優(yōu)點(diǎn)：小的子模塊可以進(jìn)行更好的優(yōu)化，實(shí)現(xiàn)更優(yōu)性能、面積缺點(diǎn)：需要對(duì)每個(gè)子模塊進(jìn)行約束，設(shè)計(jì)效率差，人工工作較多應(yīng)用場(chǎng)景：針對(duì)性能、成本的設(shè)計(jì)目標(biāo)系統(tǒng)功能分析、子模塊規(guī)劃子模塊設(shè)計(jì)/IP選型子模塊驗(yàn)證&實(shí)現(xiàn)系統(tǒng)集成&驗(yàn)證系統(tǒng)實(shí)現(xiàn)系統(tǒng)功能與特性確認(rèn)傳統(tǒng)設(shè)計(jì)方法存在的問(wèn)題（1）大規(guī)模集成電路無(wú)論單獨(dú)使用TopDown方法還是BottomUp方法，都難以滿足設(shè)計(jì)需求（2）傳統(tǒng)方法需要多次迭代，無(wú)法滿足工業(yè)對(duì)TTM的要求（3）無(wú)法適應(yīng)基于IP核的SoC設(shè)計(jì)方法（4）人力、時(shí)間消耗代價(jià)巨大

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