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文檔簡介

1、第三章半導(dǎo)體存儲器 第三章 半導(dǎo)體存儲器 1存儲器的分類 外存儲器 內(nèi)存儲器半導(dǎo)體存儲器 RAM ROM 由上至下容量越來越大,速度越來越慢 通用存放器堆及 指令、數(shù)據(jù)緩沖棧 高速緩存 主存儲器 聯(lián)機外存儲器 脫機外存儲器第三章 半導(dǎo)體存儲器 半導(dǎo)體存儲器存儲器是計算機中用來記錄信息的設(shè)備。由能夠表示二進制數(shù)“0和“1的、具有記憶功能的一些物理器件組成。能存放一位二進制數(shù)的物理器件稱為一個存儲元。假設(shè)干存儲元構(gòu)成一個存儲單元。RAM:隨機存取存儲器Random Access Memory又稱讀寫存儲器 靜態(tài)RAMStatic RAM,簡稱SRAM動態(tài)RAMDynamic RAM簡稱DRAM R

2、OM:只讀存儲器Read Only Memory掩模式ROM 可編程序只讀存儲器PROMProgammable ROM 可改寫的只讀存儲器EPROMErasable Programmable ROM 第三章 半導(dǎo)體存儲器 2內(nèi)存儲器的性能指標 存儲容量 最大存取時間 功耗 可靠性 平均故障間隔時間MTBF 集成度 第三章 半導(dǎo)體存儲器 3.2 隨機存取存儲器RAM 1根本結(jié)構(gòu) 存儲矩陣地址譯碼器存儲器控制電路三態(tài)雙向緩沖器存儲矩陣地址譯碼器地址寄存器地址總線讀寫放大器數(shù)據(jù)寄存器數(shù)據(jù)總線控制電路OEWECESRAM芯片的結(jié)構(gòu)存儲矩陣地址總線I/O緩沖器數(shù)據(jù)總線讀寫控制/動態(tài)刷新電路RAS#DRA

3、M芯片的結(jié)構(gòu)地址鎖存器CAS#WE#1靜態(tài)隨機存取存儲器SRAM2動態(tài)隨機存取存儲器DRAM靜態(tài)RAM的存儲元由雙穩(wěn)態(tài)觸發(fā)器構(gòu)成,每個觸發(fā)器由46個晶體管組成。存儲信息穩(wěn)定。 SRAM讀寫速度快,通常用來做Cache。動態(tài)存儲器由一個小電容存儲由電容是否帶電決定所存儲的信息。附加器件僅需一個晶體管開關(guān),以決定對電容器的操作。所以DRAM耗電少,且集成度高。但是由于電容存在的漏電現(xiàn)象而使其存儲的信息不穩(wěn)定,故DRAM芯片需要定時刷新。 DRAM主要用來做內(nèi)存第三章 半導(dǎo)體存儲器 3. 典型存儲器芯片舉例CMOS RAM芯片62648KB: 主要引腳功能地址線:A0-A12;數(shù)據(jù)線:D0-D7;輸

4、出允許信號:OE;寫允許信號:WE;選片信號:CS1,CS2。NCA12A7A6A5A4A3A2A1A0D0D1D2GND VCC WE CS2A8 A9 A11 OE A10 CS D7 D6 D5 D4 D3 1 28 2 27 3 26 4 25 5 24 6 23 7 22 8 21 9 20 10 19 11 18 12 17 13 16 14 15 4. SRAM與CPU的連接(6264) D0D7A0A12WEOECS1CS2A0A12WRRD譯碼電路高位地址信號D0D7第三章 半導(dǎo)體存儲器 譯碼電路將輸入的一組二進制編碼變換為一個特定的輸出信號,即: 將輸入的一組高位地址信號通

5、過變換,產(chǎn)生一個有效的輸出信號,用于選中某一個存儲器芯片,從而確定了該存儲器芯片在內(nèi)存中的地址范圍。第三章 半導(dǎo)體存儲器 全地址譯碼用全部的高位地址信號作為譯碼信號,使得存儲器芯片的每一個單元都占據(jù)一個唯一的內(nèi)存地址。所接芯片的地址范圍:F0000HF1FFFHA19A18A17A16A15A14A13&1CS1第三章 半導(dǎo)體存儲器 局部地址譯碼用局部高位地址信號而不是全部作為譯碼信號,使得被選中得存儲器芯片占有幾組不同的地址范圍。兩組地址: F0000HF1FFFH B0000HB1FFFHA19A17A16A15A14A13&1CS1第三章 半導(dǎo)體存儲器 應(yīng)用舉例地址范圍為:38000H3

6、9FFFHD0D7A0A12WEOECS1CS2A0A12WRRDD0D7A19G1G2AG2BCBA&A18A14A13A17A16A15VCCY0第三章 半導(dǎo)體存儲器 與8088的連接1#&2#: 88000H8BFFEH 偶地址 3#&4#: 88001H8BFFFH 奇地址 D0D3A0A12D0D3A0A12D0D3A0A12D0D3A0A12A1A13 D0D3D4D7D8D11D11D15&A0 74LS138E3A19 M/IO A16A15A14CBA1A18A17 1#2#3#4#WE OE CS CS CS CS WE OE WE OE WE OE E2 E1 BHE 與

7、8086的連接Q2 WR RD 3.3 動態(tài)隨機存取存儲器DRAM 1DRAM根本存儲單元及其工作原理 2簡單DRAM芯片舉例 2164A:64K1bit采用行地址和列地址來確定一個單元;行列地址分時傳送,共用一組地址信號線;地址信號線的數(shù)量僅為同等容量SRAM芯片的一半。第三章 半導(dǎo)體存儲器 RAS:行地址選通信號。用于鎖存行地址;CAS:列地址選通信號。地址總線上先送上行地址,后送上列地址,它們分別在RAS和CAS有效期間被鎖存在鎖存器中。DIN: 數(shù)據(jù)輸入DOUT:數(shù)據(jù)輸出 2164WE:寫允許信號第三章 半導(dǎo)體存儲器 WE=0 數(shù)據(jù)寫入WE=1 數(shù)據(jù)讀出NCDINWERASA0A2A1

8、GND VCCCASDOUTA6A3A4A5A7 1 16 2 15 3 14 4 13 5 12 6 11 7 10 8 9 DOUT輸出緩沖器A0A1A2A3A4A5A6A7128存儲矩陣128讀出放大器1/2(1/128列譯碼器)128讀出放大器128128存儲矩陣1/128行譯碼器1/128行譯碼器128存儲矩陣128讀出放大器1/2(1/128列譯碼器)128讀出放大器128128存儲矩陣8位地址鎖存器 1/4I/O門行時鐘緩沖器列時鐘緩沖器寫允許時鐘緩沖器數(shù)據(jù)輸入緩沖器 RASCASWEDIN1281282164內(nèi)部結(jié)構(gòu)示意圖 3動態(tài)RAM的連接與再生將存放于每位中的信息讀出再照原

9、樣寫入原單元的過程-刷新定時集中再生方式非同步再生方式 同步式再生方式 第三章 半導(dǎo)體存儲器 4內(nèi)存條簡介 內(nèi)存條的性能指標EDO DRAM(Extended Data Out)存取時間5070ns SDRAM(Synchronous DRAM)存取時間610ns第三章 半導(dǎo)體存儲器 內(nèi)存條的種類 SIMMSingle Inline Memory Module單列直插式內(nèi)存模塊72線:32位數(shù)據(jù)、12位行列公用地址、RAS#、CAS#等在Pentium微型機中必須成對使用 EDODIMMDual Inline Memory Module雙列直插式內(nèi)存模塊168線:64位數(shù)據(jù)、14位行列公用地址

10、、RAS#、CAS#等可單數(shù)使用EDO/SDRAM位擴展字擴展字位擴展用多片存儲芯片構(gòu)成一個需要的內(nèi)存空間,它們在整個內(nèi)存中占據(jù)不同的地址范圍,任一時刻僅有一片或一組被選中-存儲器的擴展。位擴展存儲器的存儲容量等于: 單元數(shù)每單元的位數(shù)當構(gòu)成內(nèi)存的存儲器芯片的字長小于內(nèi)存單元的字長時,就要進行位擴展,使每個單元的字長滿足要求。字節(jié)數(shù)字長位擴展例用8片2561芯片構(gòu)成2568存儲器。74LS138A8A15DBABD0D1D7A0A7CB芯片控制信號位擴展方法:將每片的地址線、控制線并聯(lián),數(shù)據(jù)線分別引出。位擴展特點: 存儲器的單元數(shù)不變,位數(shù)增加。字擴展地址空間的擴展。芯片每個單元中的字長滿足,

11、但單元數(shù)不滿足。擴展原那么:每個芯片的地址線、數(shù)據(jù)線、控制線并聯(lián),僅片選端分別引出,以實現(xiàn)每個芯片占據(jù)不同的地址范圍。A9A0 D7D0 A9A0 CS2114 WE D7D0 6:64譯 碼 器 A9A0 D7D0 A9A0 CS2114 WE D7D0 A9A0 D7D0 A9A0 CS2114 WE D7D0 A9A0 D7D0 A9A0 CS 2114 WE D7D0 A9A0 D7D0 A9A0 CS 2114 WE D7D0 A9A0 D7D0 A9A0 CS2114 WE D7D0 A15A10 A9A0 IO/M CPU WE D7D0 用2114芯片組成4K RAM全局譯碼結(jié)

12、構(gòu)圖字位擴展根據(jù)內(nèi)存容量及芯片容量確定所需存儲芯片數(shù);進行位擴展以滿足字長要求;進行字擴展以滿足容量要求。假設(shè)已有存儲芯片的容量為LK,要構(gòu)成容量為M N的存儲器,需要的芯片數(shù)為: M / L N / KA8A9A0A7D0D7地址線數(shù)據(jù)線A0 CE 4 I/OA0 CE 32564A7 I/OA0 CE 6 I/OA0 CE 52564A7 I/OA0 CE 8 I/OA0 CE 72564A7 I/OA0 CE 2 I/OA0 CE 12564A7 I/O譯碼器用2564位的芯片組成1K RAM的方框圖3.4只讀存儲器的結(jié)構(gòu)、特點和分類 1只讀存儲器的分類、結(jié)構(gòu)和特點ROM的分類掩模ROM

13、一次性可寫ROM可讀寫ROM第三章 半導(dǎo)體存儲器 ROM的結(jié)構(gòu)存儲矩陣地址譯碼器輸出緩沖器ROM的特點非易失性ROM的分類 掩模編程的ROMMask Programmed ROM 現(xiàn)場編程ROM 可改寫的PROMErasable Programable ROM UVEPROM:紫外線擦洗的EPROMUltraviolet EPROM E2PROM:電擦洗的EPROMElectrically EPROM 或稱EAROM:電改寫的ROM,即Electrically Alterable ROM 第三章 半導(dǎo)體存儲器 2紫外線擦除可編程只讀存儲器UVEPROM 特點:可屢次編程寫入;掉電后內(nèi)容不喪失;

14、內(nèi)容的擦除需用紫外線擦除器。第三章 半導(dǎo)體存儲器 EPROM 27648K8bit芯片,其引腳與SRAM 6264完全兼容:地址信號:A0 A12數(shù)據(jù)信號:D0 D7輸出信號:OE片選信號:CE編程脈沖輸入:PGM2764的工作方式數(shù)據(jù)讀出編程寫入擦除標準編程方式快速編程方式編程寫入的特點:每出現(xiàn)一個編程負脈沖就寫入一個字節(jié)數(shù)據(jù)3電擦除可編程只讀存儲器E2PROM 特點:可在線編程寫入;掉電后內(nèi)容不喪失;電可擦除。第三章 半導(dǎo)體存儲器 EEPROM芯片98C64A8K8bit芯片;13根地址線A0 A12;8位數(shù)據(jù)線D0 D7;輸出允許信號OE;寫允許信號WE;選片信號CE;狀態(tài)輸出端READ

15、Y/BUSY。工作方式數(shù)據(jù)讀出編程寫入擦除字節(jié)寫入:每一次BUSY正脈沖寫 入一個字節(jié)自動頁寫入:每一次BUSY正脈寫 入一頁1 32字節(jié)字節(jié)擦除:一次擦除一個字節(jié)片擦除:一次擦除整片EEPROM的應(yīng)用可通過編寫程序?qū)崿F(xiàn)對芯片的讀寫,但 每寫入一個字節(jié)都需判斷READY/BUSY 端的狀態(tài),僅當該端為高電平時才可寫 入下一個字節(jié)。4Flash閃速存儲器 特點:通過向內(nèi)部控制存放器寫入命令的方法來控制芯片的工作方式。第三章 半導(dǎo)體存儲器 工作方式數(shù)據(jù)讀出編程寫入:擦除讀單元內(nèi)容讀內(nèi)部狀態(tài)存放器內(nèi)容讀芯片的廠家及器件標記數(shù)據(jù)寫入,寫軟件保護字節(jié)擦除,塊擦除,片擦除擦除掛起3.5 高速緩沖存儲器Ca

16、che 概述 由于CPU與主存之間在執(zhí)行速度上存在較大的差異,為提高CPU的效率,并考慮到價格因素,基于程序的局部性原理,在CPU與主存之間增加的高速緩沖存儲器Cache技術(shù)第三章 半導(dǎo)體存儲器 CPUCache主 存DB存儲器訪問的局部性原理存儲器訪問的局部性指處理器訪問存儲器時,無論取指令還是取數(shù)據(jù),所訪問的存儲單元都趨向于聚集在一個較小的連續(xù)單元區(qū)域中。時間上的局部性最近的將來要用到的信息很可能就是現(xiàn)在正在使用的信息。主要由循環(huán)造成。空間上的局部性最近的將來要用到的信息很可能與現(xiàn)在正在使用的信息在空間上是鄰近的。主要由順序執(zhí)行和數(shù)據(jù)的聚集存放造成。Cache的命中率Cache與內(nèi)存的空間

17、比一般為:1128CPU讀取指令或數(shù)據(jù)時首先在Cache中找,假設(shè)找到那么“命中,否那么為“不命中。命中率影響系統(tǒng)的平均存取速度系統(tǒng)的平均存取速度= Cache存取速度命中率+RAM存取速度不命中率第三章 半導(dǎo)體存儲器 Cache的讀寫操作讀操作寫操作貫穿讀出式旁路讀出式寫穿式回寫式貫穿讀出式CPUCache主 存CPU對主存的所有數(shù)據(jù)請求都首先送到Cache,在Cache中查找。假設(shè)命中,那么切斷CPU對主存的請求,并將數(shù)據(jù)送出;如果不命中,那么將數(shù)據(jù)請求傳給主存。旁路讀出式CPU向Cache和主存同時發(fā)出數(shù)據(jù)請求。如果命中,那么Cache將數(shù)據(jù)回送給CPU,并同時中斷CPU對主存的請求;假

18、設(shè)不命中,那么Cache不做任何動作,由CPU直接訪問主存。CPUCache主 存寫穿式從CPU發(fā)出的寫信號送Cache的同時也寫入主存。CPUCache主 存回寫式數(shù)據(jù)一般只寫到Cache,當Cache中的數(shù)據(jù)被再次更新時,將原更新的數(shù)據(jù)寫入主存相應(yīng)單元,并接受新的數(shù)據(jù)。CPUCache主 存更新寫入Cache的分級體系結(jié)構(gòu)一級Cache:容量一般為8KB-6KB二級Cache:容量一般為128KB-2MB指令Cache和數(shù)據(jù)CachegPdLaI7F3C0y)v&s#pXmUiRfOcK9H5E2B+x(u%rZoWkThQeMbJ8G4D1z-w*t!qYnVjSgOdLaI6F3C0y

19、)v%s#pXlUiRfNcK8H5E2A+x(u$rZnWkThPeMbJ7G4D1z-w&t!qYmVjSgOdL9I6F3B0y)v%s#oXlUiQfNcK8H5D2A+x*u$rZnWkShPeMaJ7G4C1z)w&t!pYmVjRgOcL9I6E3B0y(v%s#oXlTiQfNbK8H5D2A-x*u$qZnWkShPdMaJ7F4C1z)w&s!pYmUjRgOcL9H6E3B+y(v%r#oWlTiQeNbK8G5D1A-x*t$qZnVkSgPdMaI7F4C0z)w&s!pXmUjRfOcL9H6E2B+y(u%r#oWlThQeNbJ8G5D1A-w*t$qYnVkS

20、gPdLaI7F3C0z)v&s#pXmUiRfOcK9H5E2B+x(u%rZoWlThQeMbJ8G4D1A-w*t!qYnVjSgPdLaI6F3C0y)v&s#pXlUiRfNcK9H5E2A+x(u$rZoWkThPeMbJ7G4D1z-w&t!qYmVjSgOdL9I6F3B0y)v%s#pXlUiQfNcK8H5E2A+x*u$rZnWkThPeMaJ7G4C1z-w&t!pYmVjRgOdL9I6E3B0y(v%s#oXlTiQfNbK8H5D2A-x*u$qZnWkShPeMaJ7F4C1z)w&t!pYmUjRgOcL9I6E3B+y(v%r#oXlTiQeNbK8G5D2

21、A-x*t$qZnVkShPdMaI7F4C0z)w&s!pXmUjRfOcL9H6E3B+y(u%r#oWlTiQeNbJ8G5D1A-x*t$qYnVkSgPdMaI7F3y(v%r#oXlTiQeNbK8G5D2A-x*t$qZnVkShPdMaI7F4C0z)w&s!pYmUjRfOcL9H6E3B+y(u%r#oWlTiQeNbJ8G5D1A-x*t$qYnVkSgPdMaI7F3C0z)v&s!pXmUiRfOcK9H6E2B+x(u%rZoWlThQeNbJ8G4D1A-w*t$qYnVjSgPdLaI7F3C0y)v&s#pXmUiRfNcK9H5E2B+x(u$rZoWkTh

22、QeMbJ7G4D1z-w*t!qYmVjSgOdLaI6F3B0y)v%s#pXlUiRfNcK8H5E2A+x(u$rZnWkThPeMbJ7G4C1z-w&t!qYmVjRgOdL9I6F3B0y(v%s#oXlUiQfNbK8H5D2A+x*u$qZnWkShPeMaJ7G4C1z)w&t!pYmVjRgOcL9I6E3B0y(v%r#oXlTiQfNbK8G5D2A-x*u$qZnVkShPdMaJ7F4C0z)w&s!pYmUjRfOcL9H6E3B+y(v%r#oWlTiaJ7G4C1z)w&t!pYmVjRgOcL9I6E3B0y(v%r#oXlTiQfNbK8G5D2A-x*

23、u$qZnVkShPdMaJ7F4C0z)w&s!pYmUjRgOcL9H6E3B+y(v%r#oWlTiQeNbK8G5D1A-x*t$qZnVkSgPdMaI7F4C0z)v&s!pXmUjRfOcK9H6E2B+y(u%rZoWlThQeNbJ8G5D1A-w*t$qYnVkSgPdLaI7F3C0z)v&s#pXmUiRfOcK9H5E2B+x(u%rZoWkThQeMbJ8G4D1z-w*t!qYnVjSgOdLaI6F3C0y)v%s#pXlUiRfNcK9H5E2A+x(u$rZoWkThPeMbJ7G4D1z-w&t!qYmVjSgOdL9I6F+x(u%rZoWkThQeMb

24、J8G4D1z-w*t!qYnVjSgPdLaI6F3C0y)v&s#pXlUiRfNcK9H5E2A+x(u$rZoWkThPeMbJ7G4D1z-w&t!qYmVjSgOdL9I6F3B0y)v%s#oXlUiQfNcK8H5D2A+x*u$rZnWkThPeMaJ7G4C1z-w&t!pYmVjRgOdL9I6E3B0y(v%s#oXlTiQfNbK8H5D2A-x*u$qZnWkShPdMaJ7F4C1z)w&s!pYmUjRgOcL9I6E3B+y(v%r#oXlTiQeNbK8G5D2A-x*t$qZnVkShPdM6E3B0y(v%s#oXlTiQfNbK8H5D2A-x*u$q

25、ZnWkShPeMaJ7F4C1z)w&t!pYmUjRgOcL9I6E3B+y(v%r#oXlTiQeNbK8G5D2A-x*t$qZnVkShPdMaI7F4C0z)w&s!pXmUjRfOcL9H6E2B+y(u%r#oWlTiQeNbJ8G5D1A-x*t$qYnVkSgPdMaI7F3C0z)v&s!pXmUiRfOcK9H6E2B+x(u%rZoWlThQeMbJ8G4D1A-w*t!qYnVjSgPdLaI7F3(u%r#oWlTiQeNbJ8G5D1A-x*t$qYnVkSgPdMaI7F3C0z)v&s!pXmUiRfOcK9H6E2B+x(u%rZoWlThQeMbJ8G4

26、D1A-w*t$qYnVjSgPdLaI7F3C0y)v&s#pXmUiRfNcK9H5E2B+x(u$rZoWkThQeMbJ7G4D1z-w*t!qYmVjSgOdLaI6F3B0y)v%s#pXlUiRfNcK8H5E2A+x(u$rZnWkThPeMbJ7G4C1z-s#pXmUiRfNcK9H5E2B+x(u$rZoWkThQeMbJ7G4D1z-w*t!qYmVjSgOdLaI6F3C0y)v%s#pXlUiRfNcK8H5E2A+x(u$rZnWkThPeMbJ7G4C1z-w&t!qYmVjRgOdL9I6F3B0y(v%s#oXlUiQfNbK8H5D2A+x*u$rZnWk

27、ShPeMaJ7G4C1z)w&t!pYmVjRgOcL9I6E3B0y(v%r#oXlTiQfNbK8G5D2A-x*u$qZnVkShPdMaJ7F4C0z)w&s!pYmUjRK8H5D2A+x*u$rZnWkShPeMaJ7G4C1z)w&t!pYmVjRgOcL9I6E3B0y(v%r#oXlTiQfNbK8G5D2A-x*u$qZnVkShPdMaJ7F4C1z)w&s!pYmUjRgOcL9H6E3B+y(v%r#oWlTiQeNbK8G5D1A-x*t$qZnVkSgPdMaI7F4C0z)v&s!pXmUjRfOcK9H6E2B+y$qZnWkShPdMaJ7F4C1z)w&

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