《硬件描述語(yǔ)言與FPGA設(shè)計(jì)技術(shù)》課件第2章 可編程邏輯器件硬件基礎(chǔ)_第1頁(yè)
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第2章可編程邏輯器件硬件基礎(chǔ)

2.1PLD可編程器件結(jié)構(gòu)2.2可編程邏輯器件分類2.3PLD電路表示

2.3PLD電路表示

2.2.1邏輯元件符號(hào)表示

2.4GAL器件結(jié)構(gòu)原理

2.4GAL器件結(jié)構(gòu)原理2.4GAL器件結(jié)構(gòu)原理2.5CPLD的結(jié)構(gòu)原理2.5CPLD的結(jié)構(gòu)原理1.邏輯陣列塊LAB2.宏單元

3.擴(kuò)展乘積項(xiàng)2.5CPLD的結(jié)構(gòu)原理4.可編程連線陣列PIA

2.5CPLD的結(jié)構(gòu)原理5.I/O控制塊2.6FPGA的結(jié)構(gòu)原理

2.6.1查找表邏輯結(jié)構(gòu)

2.6.2CycloneIII系列器件

的結(jié)構(gòu)原理

2.4.2CycloneIII系列器件的結(jié)構(gòu)原理2.6.2CycloneIII系列器件的結(jié)構(gòu)原理

2.6.2CycloneIII系列器件的結(jié)構(gòu)原理

2.4FPGA的結(jié)構(gòu)原理

2.4.2CycloneIII系列器件的結(jié)構(gòu)原理2.6.2CycloneIII的結(jié)構(gòu)原理

CycloneIII系列器件的結(jié)構(gòu)原理2.6.2CycloneIII系列器件的結(jié)構(gòu)原理

2.6.2CycloneIII系列器件的結(jié)構(gòu)原理

2.7CPLD/FPGA的編程與配置目前常見的大規(guī)模可編程邏輯器件的編程工藝有三種：基于電可擦除存儲(chǔ)單元的EEPROM或Flash技術(shù)。CPLD—般使用此技術(shù)進(jìn)行編程?；赟RAM查找表的編程單元。對(duì)該類器件，編程信息是保存在SRAM中的，SRAM在掉電后編程信息立即丟失，在下次上電后，還需要重新載入編程信息。因此該類器件的編程一般稱為配置。大部分FPGA采用該種編程工藝?；谝淮涡钥删幊谭慈劢z編程單元。Actel的部分FPGA采用這種結(jié)構(gòu)。2.7CPLD/FPGA的編程與配置（1）基于電可擦除存儲(chǔ)單元的EEPROM或Flash技術(shù)。

（2）基于SRAM查找表的編程單元。

（3）基于一次性可編程反熔絲編程單元。2.7.1CPLD在系統(tǒng)編程JTAG邊界掃描

2.7.1CPLD在系統(tǒng)編程2.7.2FPGA的配置方式

用JTAG進(jìn)行FPGA的配置

2.7CPLD/FPGA的編程與配置FPGA專用配置器件2.7CPLD/FP

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