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1、施工招標投標文件項目名稱： 投標文件內(nèi)容： 技術(shù)部分 投標人： (蓋章)法定代表人或其委托代理人： （簽字或蓋章）日期: 年 月 日目錄示例: （黑體小二號空一行）目錄（黑體小二加粗居中）（黑體小二號空一行）1緒論(目錄按三級標題編寫，且要與正文標題一致。各章的名稱黑體四號加粗，其余宋體小4。) 1.1 研究背景1 1.2 圖像處理領(lǐng)域的研究現(xiàn)狀3 1.3 本課題的研究內(nèi)容7 1.3.1 Altera MegaCore管理和使用83關(guān)于海量圖像無級縮放 3.1概述15 3.2無級縮放算法原理18 3.3無級縮放算法的PC模擬204結(jié)論 24正文示例：1前言（黑體三號加粗，1級標題段前為0.8行

2、、段后為0.5行）1.1概述（黑體小三號加粗）IP（Intellectual Property）就是常說的知識產(chǎn)權(quán)，IPCore（知識產(chǎn)權(quán)核）則是指用于產(chǎn)品應(yīng)用的專用集成電路（ASIC）或者可編程邏輯器件（PGA）的邏輯塊或數(shù)據(jù)塊。（中文正文宋體小四，英文正文用Times New Roman，正文行間距為1.5倍） .141 DDR IP Core的時序性描述（黑體四號加粗）1411對DDR SDRAM的初始化時序（黑體小四號加粗）通過DDR IPCore 對DDR 和DDR2 SDRAM進行初始化是有分別的，由于在本次項目設(shè)計過程中實際采用的是DDR SDRAM，因此本文僅僅對前者的初始化時序進行討論。普通表示例：表1.1Altera 可提供的基本宏功能單元類 型描 述算術(shù)組件包括累加器、加法器、乘法器和LPM算術(shù)函數(shù)門包括多路復(fù)用器和LPM門函數(shù)I/O組件包括時鐘數(shù)據(jù)恢復(fù)（CDR）、鎖相環(huán)（PLL）、雙數(shù)據(jù)速率（DDR）、千兆位收發(fā)器塊（GXB）、LVDS收發(fā)器和發(fā)送器、PLL重新配置和遠程更新宏功能模塊存儲器包括FIFO Partitioner、RAM和ROM宏功能模塊存儲組件存儲器、移位寄存器宏模塊和LPM存儲器函數(shù)（表標題中文黑體小四號，數(shù)字及字母

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