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文檔簡介

實驗四實驗內容：組合邏輯電路設計1. 設計要求：用兩片7400設計一個4輸入的多數(shù)表決電路，即在4人或3人表決為1時通過，否則不通過。設計步驟：設計要求真值表卡諾圖簡化邏輯表達式邏輯圖接線圖調試檢驗2. 用7400實現(xiàn)一位半加器，即不考慮來自低位的進位。3. 用雙四選一數(shù)據(jù)選擇器74153來實現(xiàn)三人表決電路（不用門電路）。4. 設計一個鎖。鎖的可以由設計者自行設定，設該鎖有規(guī)定的4位二進制代碼A3A2A1A0的輸入端和一個開鎖鑰匙信號B的輸入端，當B=1（有鑰匙插入）且符合設定的時，允許開鎖信號輸出Y1=1（開鎖），報警信號輸出Y2=0；當有鑰匙插入不對時，Y1=0，Y2=1（報警）；當無鑰匙但是對否，Y1=Y2=0。插入時，無論提示：1.設定四位P3P2P1P02.判斷的對錯就是判斷兩個二進制數(shù)P3P2P1P0與A3A2A1A0是否相等。3.備用芯片：7400，7420， 7486 ，74138，74153?？梢赃x擇其中的一種或多種芯片來完成設計。7486

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